Cosa significa questo simbolo (tre triangoli collegati)?


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Cosa significano i simboli e ? Qual è lo scopo del componente? La seconda immagine mostra il suo schema. G D S IGDSNGDSI


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Contesto, contesto, contesto. Dove lo hai trovato? Pubblica un link all'articolo. (Mettilo nella tua domanda e non nei commenti.)
Transistor

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Sta migliorando. Perché non divulgare il numero di parte e fornire un collegamento al foglio dati?
Transistor

1
Non c'è il foglio dati, perché lo vedo dalla carta nell'IEEE
XM551

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Forse il documento IEEE ha un titolo o un URL che potresti pubblicare. È come tirare i denti.
Transistor

1
Titolo: Un IC da
m di

Risposte:


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Cosa significano il simbolo, GDSN e GDSI?

Sembra che tu abbia risposto alla tua domanda. La tua seconda immagine mostra quali sono i tre triangoli.

Sono semplicemente tre inverter logici in cascata con un'abilitazione.

La forza motrice di ciascun inverter logico diventa più forte man mano che vai a destra. In altre parole, l'ingresso potrebbe essere molto debole e l'uscita sarà molto forte.

È un buffer invertente.

e qual è il suo scopo?

I tripli inverter stanno guidando carichi capacitivi elevati, vale a dire le porte dei due MOSFET. Se non ci fosse stato un triplo inverter, sarebbe necessario troppo tempo per caricare e scaricare le porte dei MOSFET. Quindi questo è chiaramente un design pensato per l'alta velocità, o semplicemente a bassa potenza durante il periodo in cui i MOSFET si aprono / chiudono.

La capacità di gate dell'ingresso al triplo inverter sarà considerevolmente più piccola della capacità di gate della coppia MOSFET.


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Non sono sicuro che sia per la velocità ... l'aggiunta di stadi in serie tenderà a ridurre la velocità (aumentare sicuramente il guadagno di corrente può, ma questo sembra un progetto a corrente estremamente bassa per la raccolta di energia.). La connessione Vpzt nell'ultima fase suggerisce che la traduzione di livello può far parte di essa.
Brian Drummond,

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(+1) La sottoscrizione GD è un forte suggerimento: immagino significhi Gate Driver .
Lorenzo Donati - Codidact.org

@BrianDrummond Hmm, sto pensando a come dovrei modificare la mia domanda per allinearla al tuo commento .. ma mi arrendo. Il tuo commento è abbastanza.
Harry Svensson,

@HarrySvensson Penso che lo lasci così com'è, hai sicuramente ragione che sta guidando un cancello ad alta capacità. Immagino che il tempo morto controllato sia una delle preoccupazioni, ma mi aspetto che sia spiegato in quel documento.
Brian Drummond,

Il segnale ritardato Vdly avrà anche una velocità di risposta inferiore che può causare problemi se non accelerato con 3 stadi di guadagno analogico x10 per inverter è il mio ragionamento.
Tony Stewart Sunnyskyguy EE75,

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A me sembra un buffer invertente a tre stadi.
Ma per quanto ne so non è un simbolo standard IEC 60617


Almeno il simbolo indica a un lettore astuto che si tratta di un inverter bufferizzato, il che implica un comportamento analogico più che standard. simboli logici +1
Tony Stewart Sunnyskyguy EE75

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