Ingegnere elettrico hdl

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Quanto costa realizzare un ASIC personalizzato?

Ho sfogliato diverse reti di produttori ASIC, ma non ho trovato un numero reale. Presumo che ci sarebbe un costo fisso associato alla creazione di maschere e simili e quindi ci sarà un costo per unità. Nota: che in realtà non voglio fare un ASIC, sono solo curioso.

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VHDL o Verilog? [chiuso]

VHDL e Verilog sono gli HDL del giorno. Quali sono i vantaggi di chi non ha alcuna esperienza con le HDL?

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RTL vs HDL? Qual è la differenza

Qual è la differenza principale tra RTL e HDL? Ad essere sincero, ho cercato / cercato su Google, ma le persone sono divise nelle loro opinioni. Ricordo uno che diceva che HDL è il linguaggio utilizzato per descrivere un circuito digitale e quando è sintetizzabile, viene considerato RTL.

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Come imparo HDL

Ho un corso di Digital Design in questo semestre e lo adoro. Ora so che la maggior parte del lavoro nei sistemi integrati e nella progettazione digitale viene prima eseguita su simulatori di computer e poi implementata utilizzando hardware. Quindi mi chiedevo come avrei dovuto imparare l'HDL. Ho qualche domanda …

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Perché i fermi inferiti sono cattivi?

Il mio compilatore si lamenta dei latch inferiti nei miei loop combinatori ( always @(*), in Verilog). Mi è stato anche detto che i dispositivi di chiusura dedotti dovrebbero essere preferibilmente evitati. Cosa c'è di esattamente sbagliato nei chiavistelli inferiti? Certamente facilitano la scrittura di loop combinatori.

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Cosa succede quando un FPGA è "programmato"?

Da quello che ho capito, il processo di programmazione di un FPGA si divide in due parti: Codifica la descrizione dell'hardware in bit che l'FPGA può comprendere (ad esempio scrivere un po 'di HDL e compilarlo) Caricare l'HDL compilato sull'FPGA. La mia domanda è: "Cosa fa l'FPGA con l'HDL compilato?". …

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Qual è la motivazione nell'uso di Verilog o VHDL su C?

Vengo da un background di programmazione e non ho troppi problemi con hardware o firmware (al massimo un po 'di elettronica e Arduino). Qual è la motivazione nell'uso dei linguaggi di descrizione hardware (HDL) come Verilog e VHDL rispetto ai linguaggi di programmazione come C o alcuni Assembly? Questo problema …

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Che cos'è un vincolo di temporizzazione del percorso falso?

Nel mondo FPGA, quali sono esattamente i vincoli dei falsi percorsi per un compilatore HDL? Perché sono utili?

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Differenza tra RTL e verilog comportamentale

Qualcuno può dirmi qual è la differenza tra RTL e codice Verilog comportamentale? Esiste una netta demarcazione netta tra i disegni a questi due livelli?

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SystemC vs HDLs

Attualmente sono coinvolto in un progetto universitario per l'implementazione di un elaboratore di un set di istruzioni esistente. L'idea è che entro la fine del progetto dovrei essere in grado di sintetizzare questo progetto ed eseguirlo in un FPGA. Finora tutto procede bene, ho iniziato a implementare il design in …

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Simulazione del design FPGA senza avere l'hardware reale

Sono nuovo di FPGA e attualmente sto prendendo la classe HDL (in particolare Verilog). Ho una conoscenza sufficiente della progettazione digitale come circuiti combinatori e sequenziali. Voglio creare un progetto simile a quello mostrato in questo video di YouTube . So anche che Xilinx ISE può elaborare segnali logici e …

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