Ingegnere elettrico fpga

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Ciclo di blocco di tutte le fasi digitali

Sto cercando di implementare un blocco di fase in un FPGA senza utilizzare alcun componente esterno (diverso dall'ADC). Per semplicità, è sufficiente bloccare a un semplice impulso binario. La frequenza dei segnali è ~ 0,1-1% dell'orologio. Non riesco a utilizzare i PLL dell'orologio di bordo perché sono in genere: Non …

9 fpga dsp pll

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Quale metodo suggerisci per la prototipazione di circuiti asincroni?

Sono rimasto sorpreso e in parte scioccato dal constatare che non esiste uno strumento adeguato per la progettazione e la prototipazione di circuiti asincroni. Continuo a cercare utilizzando Google e altri mezzi per trovare un buon metodo per progettare circuiti asincroni VLSI, ma finora le ricerche non sono riuscite a …

9 fpga vlsi eda

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Come ottenere un design FPGA che funzionerà sicuramente su hardware reale

Ho appena iniziato a studiare la progettazione della logica digitale con FPGA e ho sviluppato molti progetti. Il più delle volte (dato che sono una specie di noob), ho un design che simula perfettamente (simulazione comportamentale) ma non si sintetizza correttamente. Quindi, la mia domanda è "quali sono le fasi …

9 digital-logic fpga design xilinx synthesis

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suggerimenti personalizzati per la progettazione di PCB FPGA

Sto progettando di progettare un PCB FPGA personalizzato. il PCB conterrà sensori. Devo leggere l'output dei sensori ed elaborarli nel processore. Ho completato molti progetti utilizzando FPGA, ma questo sarà il mio primo progetto personalizzato in cui dovrò considerare anche la configurazione hardware. Ho fatto ricerche di recente, ma è …

9 pcb fpga design

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Simulazione del design FPGA senza avere l'hardware reale

Sono nuovo di FPGA e attualmente sto prendendo la classe HDL (in particolare Verilog). Ho una conoscenza sufficiente della progettazione digitale come circuiti combinatori e sequenziali. Voglio creare un progetto simile a quello mostrato in questo video di YouTube . So anche che Xilinx ISE può elaborare segnali logici e …

9 fpga hdl

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Quando AXI4Lite sarebbe una scelta migliore rispetto al bus APB?

Sto lavorando per migliorare e ripulire un design FPGA di grandi dimensioni già funzionale che ha un bus dati a 64 bit. Una delle domande che sono emerse è "dovremmo trasferire tutti i nostri bus in AXI4Lite / APB o dovremmo lasciarli così come sono?" Alcuni sono AXI4Lite e altri …

8 fpga vhdl interface hardware bus

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Quali sono gli usi tipici di un soft-processor come MicroBlaze?

So che la combinazione FPGA-DSP viene generalmente utilizzata per l'elettronica di potenza di fascia alta / ultrasuoni / risonanza magnetica / ecc. È possibile per il soft-processor sostituire completamente il DSP anche su FPGA di fascia bassa come Spartan 3/6? Aggiunto: quale sarebbe la ragione per avere più processori softcore …

8 fpga processor microblaze softcore

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come salvare correttamente un'architettura in un fpga ic per sempre

Considerando che ho realizzato un'architettura per fare qualcosa di specifico, scritto in vhdl, per esempio. Posso 'bruciarlo' in un chip FPGA, per sempre? O come dovrei farlo, proteggendo la proprietà intellettuale sapendo che può essere letta dalla memoria flash seriale?

8 fpga

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Rileva registri che non sono ripristinati

Quando scrivo Verilog, uso una varietà di "linters" che daranno errori e avvertimenti. Questi sono il mio simulatore (ModelSim), il mio compilatore (Quartus II), insieme a una linter (Verilator). Insieme, ho una buona copertura per insidie comuni, come disallineamenti delle dimensioni del bus e fermi dedotti. Sfortunatamente, nessuno dei tre …

8 fpga verilog

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Conteggio del gate logico FPGA

Ho trovato una scheda FPGA che mi piaceva. Utilizza uno Xilinx Spartan 6 LX45. Quando sono andato al foglio dati per la serie Spartan 6 , mi ha detto solo che c'erano 43.661 celle logiche. A quante porte corrisponde? Oppure, come potrei capire il numero di gate totali dal numero …

8 digital-logic fpga xilinx spartan

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Quanto velocemente si esegue o si moltiplica a 64 bit su un FPGA?

Quando si utilizza un FPGA normale come Xilinx Spartan 3 o Virtex 5, quanti cicli richiede una moltiplicazione o divisione a 64 bit in virgola mobile a precisione doppia? A quanto ho capito, l'FPGA non ha una FPU rigida ed è necessario crearne una utilizzando le librerie IEEE standard o …

8 fpga xilinx math spartan floating-point

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Confronta l'implementazione di un semplice design di automazione su un MCU rispetto a un FPGA / CPLD

Lavoro con MCU dagli anni '90 e recentemente mi sono avventurato nella scena FPGA con i chip della serie Spartan6 di Xilinx. Supponendo un semplice design di automazione industriale con sensori e motori e un po 'di intelligenza per collegare tutto, su quale tipo di dispositivo potrei finire il design …

8 microcontroller fpga xilinx development spartan

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In che modo i microprocessori commerciali incontrano i tempi con un orologio Gigahertz?

Sto riscontrando problemi nel realizzare un design FPGA relativamente semplice (per un Altera Cyclone IV) che soddisfa i tempi per la logica guidata da un clock a 250 MHz. Questo mi fa meravigliare di come i microprocessori commerciali (come Intel Core i7) riescano a soddisfare i tempi a frequenze di …

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Come utilizzare la porta HDMI su FPGA (base)

Due domande. Ho un FPGA Xilinx Spartan 6 che ha solo ingressi e uscite HDMI. Esiste una sorta di guida o codice pre-scritto che posso usare per iniziare a inviare immagini sullo schermo? Non ho idea di come iniziare e non sono stato in grado di trovare risorse. In secondo …

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Buffer VGA FPGA. Come leggere e scrivere?

Ho una scheda Altera DE2 e sto provando a disegnare sprite. Sto riscontrando problemi nell'implementazione di un buffer dello schermo. Ho un'entità di visualizzazione che a una velocità di 25 MHZ genera pixel per la visualizzazione VGA. Speravo di implementare un buffer in SDRAM. L'idea originale era quella di caricare …

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